图示时序逻辑电路为( )。附：触发器的逻辑状态表为：

admin2019-10-12 51

问题图示时序逻辑电路为( )。

附：触发器的逻辑状态表为：

选项 A、左移的三位移位寄存器，寄存数据是010
B、右移的三位移位寄存器，寄存数据是010
C、左移的三位移位寄存器，寄存数据是000
D、右移的三位移位寄存器，寄存数据是000

答案A

解析由逻辑图可知，三个触发器均为下降沿触发的D触发器。工作之初由复位信号

设置触发器的初始状态。

=0触发器初态为1，

=0触发器初态为0。F₂F₁F₀三个触发器初始信号Q₂Q₁Q₀为101，输入信号D₂=Q₁=0，D₁=Q₀=1，D₀=Q₂=1。由输入信号D的状态及其逻辑状态表可得第一个时钟脉冲的下降沿到来时Q₂Q₁Q₀为011，按照此规律，接下来的时钟脉冲下降沿时刻到来时Q₂Q₁Q₀依次被置为110、101、011、110、…，可见这是一个循环左移寄存器。

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